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采用DDS实现数字信号发生器, 时钟频率为100MHz,可输出1K到10M的正弦波
大小：8M 更新时间：2019-10-17 下载积分：9分
采用DDS实现数字信号发生器, 时钟频率为100MHz,可输出1K到10M的正弦波
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一个基于Verilog的数码相框的实现，全是Verilog写的
大小：10M 更新时间：2019-10-17 下载积分：9分
一个基于Verilog的数码相框的实现，全是Verilog写的。里面包括一个SD驱动的文件系统.
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