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分频器设计——50MHZ(含verilog程序)
大小：69K 更新时间：2017-03-24 下载积分：2分
分频器设计——50MHZ(含verilog程序) 、实验目的 1、熟悉分频器的原理； 2、掌握采用Verilog HDL语言设计分频器的方法； 3、进一步学习利用VerilogHDL语言进行层次设计的方法。
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大唐电信FPGA-CPLD数字电路设计经验分享
大小：951K 更新时间：2017-03-24 下载积分：2分
大唐电信FPGA-CPLD数字电路设计经验分享 在数字电路的设计中，时序设计是一个系统性能的主要标志，在高层次设计方法中，对时序控制的抽象度也相应提高，因此在设计中较难把握，但在理解RTL 电路时序模型的基础上...
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初学者怎么学习FPGA
大小：182K 更新时间：2017-03-24 下载积分：2分
初学者怎么学习FPGA FPGA 作为一种高新的技术，已经逐渐普及到了各行各业，无论是消费类、通信类、电子行业都无处不在它的身影，从1985 年第一颗FPGA 诞生至今，FPGA 已经历了将近20 多个年头，从当初的几百个门...
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ucf文件分析
大小：911K 更新时间：2017-03-24 下载积分：2分
ucf文件分析 利用FPGA进行系统设计常用的约束主要分为3类。 （1）时序约束：主要用于规范设计的时序行为，表达设计者期望满足的时序条件，知道综合和布局布线阶段的优化算法等。 （2）布局布线约束：主要用于指...
