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采用异步通信子系统的多板FPGA综合
资料介绍
随着数字设计的复杂性不断增加，设计抽象已经从原理图增加到基于语言，并且正在向抽象行为规范迁移。将电路或系统划分为一组较小的可管理组件已成为一项核心和关键的设计任务。分区设计之间的数据同步的异步技术（通常在不同的时钟域中）是低功耗和片上系统设计中经过深入研究的领域。在本文中，我们提出了一个高级综合系统，它可以自动合成并生成多板FPGA系统的结构输出，而无需修改源HDL代码。针对多个原型板的目标是改进性能以改进原型制作时间和成本。具有通信单元的优化异步通信通道在合成期间自动插入到多板FPGA实现中，同步在本地时钟FPGA之间异步传输的FPGA间数据包
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| VLSI-SOC2005.doc | 638K |
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