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Vivado 设计流程中文版
资料介绍
Vivado 设计分为 Project Mode 和 Non-project Mode 两种模式，一般简单设计中，我们常用的是 Project Mode。在本手册中，我们采用 Xilinx 数模混合口袋实验室，将以一个简单的实验案例，一步一步的完成 Vivado 的整个设计流程。
在本次实验中，将会学习如何使用 Xilinx Vivado 2017.1 创建、综合、实现、仿真等功能。本实验通过编写一个流水灯实验来展示使用 Xilinx Vivado 来进行基本的 FPGA 设计。
通过编写 HDL 文件的方式创建 Vivado 设计。
建立仿真
通过 I/O Planing 添加管脚约束
通过编写约束文件添加管脚约束
添加时序约束
生成 Bitstream 文件
将生成的 Bitstream 文件下载到 FPGA 开发板里
Vivado 设计分为 Project Mode 和 Non-project Mode 两种模式，一般简单设计中，我们常用的是 Project Mode。在本手册中，我们采用 Xilinx 数模混合口袋实验室，将以一个简单的实验案例，一步一步的完成 Vivado 的整个设计流程。
在本次实验中，将会学习如何使用 Xilinx Vivado 2017.1 创建、综合、实现、仿真等功能。本实验通过编写一个流水灯实验来展示使用 Xilinx Vivado 来进行基本的 FPGA 设计。
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| 文件名 | 大小 |
| Vivado_设计流程.pdf | 3M |
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