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基于VHDL的FPGA设计，数字显示器，七段译码器
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基于VHDL的FPGA设计，数字显示器，七段译码器
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| 文件名 | 文件大小 | 修改时间 |
| 基于VHDL的FPGA设计，数字显示器，七段译码器，在DE2-115上实现/lab3_vhdl仿真及结果分析.doc | 536KB | 2015-12-08 21:42:20 |
| 基于VHDL的FPGA设计，数字显示器，七段译码器，在DE2-115上实现/lab2_vhdl仿真及结果分析.doc | 896KB | 2015-12-08 21:42:08 |
| 基于VHDL的FPGA设计，数字显示器，七段译码器，在DE2-115上实现 | 1KB | 2015-12-08 21:42:32 |
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