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VHDL模块电路原理图画法
资料介绍
一、创建VHDL模块,生成一个原理图符号
1、在项目导航器（Project Navigator）菜单中，点击
Project ——>Add Source 添加一个VHDL模块——
2、 在Source in Project 窗口中，选中计数器模块
3、 在Process 窗口中，点击Design Utilities之前的“+”符号，然后双击Create Schematic Symbol
经过以上步骤，名称为“counter”的图形化元件被放入到工程项库中。
部分文件列表
| 文件名 | 大小 |
| VHDL模块电路原理图画法.doc | 695K |
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