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基于VHDL数字跑表报告
资料介绍
本文利用XILINX-ISE以及XILINX EDA教学实验开发板实现数字跑表的开始、暂停以及复位等功能。ISE工程利用VHDL语言编写，主要由时钟分频电路模块、主控电路模块、计数器模块、控制电路模块这几大模块构成。
通过分频器将晶振所提供的48MHz信号分频成100Hz时钟信号作为最低位计数器的计时信号，通过将6个计数器级联（异步级联），再经过数据选择器和显示译码器，以动态显示模式将显示译码器的段选信号分位输出给六个8段LED数码管显示，六位LED数码管显示分、秒，0.1s,0.01s。使用按键开关可实现暂停/继续计时操作，以及复位清零操作。
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| 基于VHDL数字跑表报告.doc | 671K |
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