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俄罗斯方块Verilog HDL程序设计

更新时间：2022-10-16 20:38:08 大小：8M 上传用户：jh03551查看TA发布的资源 标签：俄罗斯方块verilog hdl 下载积分：9分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

通过此次项目，完成以下目的： 熟悉Xilinx FPGA的架构及开发流程 设计一个功能完整的系统，掌握FSM + Datapath的设计方法。 实验内容 项目介绍 本项目主要在FPGA上实现了一个经典小游戏“俄罗斯方块”。本项目基本解决方案是，使用Xilinx Zynq系列开发板ZedBoard作为平台，实现主控模块，通过VGA接口来控制屏幕进行显示。 系统框架 整个系统由四部分组成，按键输入处理模块、控制模块、数据路径模块以及VGA显示接口模块。整个系统的结构

部分文件列表

文件名文件大小修改时间
Verilog设计/Verilog设计/Tetris_Zedboard.zip5442KB2015-11-21 11:32:34
Verilog设计/Verilog设计/Verilog HDL高级数字设计实验报告.docx1470KB2016-03-21 20:10:02
Verilog设计/Verilog设计/verilog展示_俄罗斯方块.pptx1167KB2016-03-21 20:11:18
Verilog设计/Verilog设计1KB2016-03-18 15:14:06
Verilog设计1KB2022-10-16 20:37:36

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