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帧同步器的Verilog代码，在FPGA上验证实现过，无误
资料介绍
帧同步器的Verilog代码，在FPGA上验证实现过，无误。作为通信系统帧传输的仿真，有限状态机同步态和失步态的切换仿真
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| 帧同步器Verilog代码/frame.v | 1KB | 2011-07-12 20:36:10 |
| 帧同步器Verilog代码/FrameDataCheck.v | 1KB | 2011-07-06 17:12:50 |
| 帧同步器Verilog代码/FrameSyn.v | 2KB | 2011-07-13 17:29:32 |
| 帧同步器Verilog代码/FrameTrans.v | 2KB | 2011-07-13 16:48:14 |
| 帧同步器Verilog代码/key.v | 1KB | 2011-07-13 16:48:02 |
| 帧同步器Verilog代码/scrambler.v | 1KB | 2011-07-11 20:22:38 |
| 帧同步器Verilog代码 | 1KB | 2012-04-01 19:25:06 |
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