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uart16550 控制器 FPGA设计verilog源码

更新时间:2023-10-07 08:59:56 大小:207K 上传用户:铁蛋锅查看TA发布的资源 标签:控制器fpgaverilog 下载积分:9分 评价赚积分 (如何评价?) 打赏 收藏 评论(0) 举报

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uart16550 控制器 FPGA设计verilog源码

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uart16550 控制器 FPGA设计verilog源码/uart16550/bench/CVS/Entries1KB2001-08-17 04:28:08
uart16550 控制器 FPGA设计verilog源码/uart16550/bench/CVS/Repository1KB2001-08-17 04:28:08
uart16550 控制器 FPGA设计verilog源码/uart16550/bench/CVS/Root1KB2001-08-17 04:28:08
uart16550 控制器 FPGA设计verilog源码/uart16550/bench/verilog/CVS/Entries1KB2001-08-17 04:28:08
uart16550 控制器 FPGA设计verilog源码/uart16550/bench/verilog/CVS/Repository1KB2001-08-17 04:28:08
uart16550 控制器 FPGA设计verilog源码/uart16550/bench/verilog/CVS/Root1KB2001-08-17 04:28:08
uart16550 控制器 FPGA设计verilog源码/uart16550/bench/verilog/uart_test.v9KB2001-08-13 00:28:04
uart16550 控制器 FPGA设计verilog源码/uart16550/bench/vhdl/.keepme1KB2001-08-13 02:52:36
uart16550 控制器 FPGA设计verilog源码/uart16550/bench/vhdl/CVS/Entries1KB2001-08-17 04:28:08
uart16550 控制器 FPGA设计verilog源码/uart16550/bench/vhdl/CVS/Repository1KB2001-08-17 04:28:08
uart16550 控制器 FPGA设计verilog源码/uart16550/bench/vhdl/CVS/Root1KB2001-08-17 04:28:08
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