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MUC+FPGA串口扩展,已调试通过,4路串口共用中断,收发fifo,波特率可调
资料介绍
MUC+FPGA串口扩展,已调试通过,4路串口共用中断,收发fifo,波特率可调,其他的可以自己添加,极具参考价值,只提供Verilog源码.rar
部分文件列表
文件名 | 文件大小 | 修改时间 |
uart_1203_4路接收fifo4路发送fifo/db/altsyncram_ckj1.tdf | 12KB | 2011-12-03 09:18:32 |
uart_1203_4路接收fifo4路发送fifo/db/altsyncram_ekj1.tdf | 12KB | 2011-12-03 09:37:20 |
uart_1203_4路接收fifo4路发送fifo/db/altsyncram_gkj1.tdf | 12KB | 2011-11-24 08:59:38 |
uart_1203_4路接收fifo4路发送fifo/db/altsyncram_ikj1.tdf | 12KB | 2011-11-29 15:51:08 |
uart_1203_4路接收fifo4路发送fifo/db/altsyncram_mkj1.tdf | 12KB | 2011-11-30 13:27:10 |
uart_1203_4路接收fifo4路发送fifo/db/a_dpfifo_4i21.tdf | 3KB | 2011-11-30 13:27:10 |
uart_1203_4路接收fifo4路发送fifo/db/a_dpfifo_ag21.tdf | 3KB | 2011-12-03 09:37:20 |
uart_1203_4路接收fifo4路发送fifo/db/a_dpfifo_fg21.tdf | 3KB | 2011-11-29 15:51:08 |
uart_1203_4路接收fifo4路发送fifo/db/a_dpfifo_h231.tdf | 3KB | 2011-11-24 08:59:38 |
uart_1203_4路接收fifo4路发送fifo/db/a_dpfifo_qe21.tdf | 3KB | 2011-12-03 09:18:32 |
uart_1203_4路接收fifo4路发送fifo/db/a_fefifo_18e.tdf | 4KB | 2011-11-30 13:27:10 |
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