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基于matlab FPGA verilog的FIR滤波器设计
资料介绍
本例程实现8阶滤波器，9个系数，由于系数的对称性，h(0)=h(8)，h1(1)=h(7)，h(2)=h(6)，h(3)=h(5)，h(4)为中间单独一个系数。
实现框图：
推导出当系数N为偶数时,例如N=4：y(n)=h(0)*{x(0)+x(n-3)}+h(1)*{x(n-1)+x(n-2)}
当系数N为奇数时，例如N=5：y(n)=h(0)*{x(0)+x(n-1)}+h(1)*{x(n-1)+x(n-3)}+h(2)*x(n-2)
1、用matlab生成和量化滤波器系数
设置参数后，点击“Design Filter”按钮，“file”—“export”，把滤波器系数导出到workspace,
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| 基于matlab FPGA verilog的FIR滤波器设计.pdf | 607K |
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