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使用Xilinx ISE工具进行数字电路设计
资料介绍
Xilinx Tools是一套软件工具，用于设计使用Xilinx现场可编程门阵列（FPGA）或复杂可编程逻辑器件（CPLD）实现的数字电路。设计程序包括（a）设计输入，（b）设计的编译和实施，（c）功能模拟和（d）测试和验证。可以使用上述CAD工具以各种方式输入数字设计：使用原理图输入工具，使用硬件描述语言（HDL） - Verilog或VHDL或两者的组合。在本实验中，我们将仅使用涉及使用Verilog HDL的设计流程。
CAD工具使您能够从Verilog HDL设计规范开始设计组合和顺序电路。下面列出了此设计过程的步骤：
1.使用模板驱动编辑器创建Verilog设计输入文件。
2.编译并实现Verilog设计文件。
3.创建测试向量并模拟设计（功能仿真），而无需使用PLD（FPGA或CPLD）。
4.分配输入/输出引脚以在目标器件上实现设计。
5.将比特流下载到FPGA或CPLD设备。
6.在FPGA / CPLD器件上进行测试设计
部分文件列表
| 文件名 | 大小 |
| ise-tutorial-Verilog.doc | 1M |
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