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一种宽温多协议时钟恢复电路的设计与实现

更新时间：2020-10-21 17:00:49 大小：262K 上传用户：gsy幸运查看TA发布的资源 标签：时钟 下载积分：1分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

时钟恢复电路（ CDR）是高速串行通讯中的重要模块,对通讯的稳定性和误码率有直接的影响,易受PVT影响。PCIE,RapidIO等高速串行通讯协议中又对CDR的性能指标分别有数据抖动特性及抖动容限的容忍范围等严格定义。由于单一协议和速率设计的CDR电路在电路应用、验证测试和集成的复杂度较大,多协议兼容是技术趋势。文中设计实现了一种多协议兼容的双环时钟恢复电路,采用集成自适应带宽的锁相环结构PI插相器,配合数字控制、相位插值的方式实现。经流片验证,在1~3.125 Gbps速率范围内抖动容限和频率偏移等指标均满足协议标准值要求,误码率小于1E-12,满足FC（FC-PI-4）、PCIE（1.1）和Rapid IO（1.3）的协议要求,工作温度范围为-55~125益。目前该电路已成功应用于PCIE、FC和RapidIO等多款SerDes中,并集成应用于多款高性能SoC芯片中。

CDR is the important module of high speed serial communication,and has direct effect on stability and bit error rate of commu-nication,and accessible to PVT. PCIE,RapidIO and other high speed serial communication protocols have strict definitions of data jitter property and jitter tolerance. Due to the complexity of CDR circuit with single protocol and speed ratio design in circuit application,test and integration,multi-protocol compatibility is the trend. A multi-protocol dual-path CDR integrated adaptive bandwidth PLL is present in this paper. Use di...

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