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应用于全数字锁相环的时间数字转换器设计

更新时间：2020-07-22 08:23:06 大小：316K 上传用户：songhuahua查看TA发布的资源 标签：数字锁相环数字转换器 下载积分：5分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

采用标准0.18 μm CMOS工艺,设计了一种应用于全数字锁相环中检测相位差大小的时间数字转换电路（TDC）.针对传统TDC电路的不足,通过加入上升沿检测电路,扩大计数器位宽,使得TDC电路不仅能完成时数转换的基本功能,而且提高了时数转换的准确性,扩大了测量范围.该设计完成了RTL级建模、仿真、综合及布局布线等整个流程.仿真结果表明,该TDC电路工作正常,在1.8V电源电压下,功耗为10 mW,能达到的分辨率约为0.3 ns,版图尺寸为255 μm×265 μm.

Using 0.18μm CMOS technology,a time-to-digital converter （TDC） is designed to detect the sizes of phase errors in the all digit phase-locked loop （ADPLL）.By adding a circuit of rising edge detection and expanding the width of counter,the designed TDC can enhance the accuracy of time to digital conversion and enlarge measurement range in addition to all the basic design includes RTL-level modeling,simulation,synthesis,and placement and ulation results show that the circuit works properly at 1.8V supply voltage with the power consumption of 10mW,the timing resolution of 0.3ns,and the core size of 255μm × 265μm.

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