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夏宇闻著作:FPGA 设计从算法设计到硬线逻辑的实现
资料介绍
夏宇闻著作:FPGA 设计从算法设计到硬线逻辑的实现
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文件名 | 文件大小 | 修改时间 |
夏宇闻著作:从算法设计到硬线逻辑的实现/CPU设计简介.pdf | 544KB | 2005-06-21 15:15:10 |
夏宇闻著作:从算法设计到硬线逻辑的实现/CPU设计简介.rar | 386KB | 2008-11-26 19:49:12 |
夏宇闻著作:从算法设计到硬线逻辑的实现/Verilog HDL的基本语法.pdf | 461KB | 2005-06-21 15:13:10 |
夏宇闻著作:从算法设计到硬线逻辑的实现/Verilog HDL的基本语法.rar | 363KB | 2008-11-26 19:49:16 |
夏宇闻著作:从算法设计到硬线逻辑的实现/Verilog HDL设计方法概述.pdf | 196KB | 2005-06-21 15:10:20 |
夏宇闻著作:从算法设计到硬线逻辑的实现/Verilog HDL设计方法概述.rar | 185KB | 2008-11-26 19:49:20 |
夏宇闻著作:从算法设计到硬线逻辑的实现/不同抽象级别的Verilog HDL模型.pdf | 207KB | 2005-06-21 15:13:32 |
夏宇闻著作:从算法设计到硬线逻辑的实现/不同抽象级别的Verilog HDL模型.rar | 179KB | 2008-11-26 19:49:22 |
夏宇闻著作:从算法设计到硬线逻辑的实现/从算法设计到硬线逻辑的实现.ppt | 432KB | 2002-09-21 00:00:00 |
夏宇闻著作:从算法设计到硬线逻辑的实现/从算法设计到硬线逻辑的实现.rar | 190KB | 2008-11-26 19:49:26 |
夏宇闻著作:从算法设计到硬线逻辑的实现/基本运算逻辑和它们的Verilog HDL模型.pdf | 240KB | 2005-06-21 15:14:10 |
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资料:bitboy
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