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一种模数转换电路的关键设计技术研究

更新时间：2020-06-20 11:04:13 大小：550K 上传用户：xiaohei1810查看TA发布的资源 标签：模数转换电路 下载积分：5分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

采用每级为1．5位精度的7级流水线结构也即7级子ADC设计了一个8位80MS／s的低功耗模数转换电路。重点考虑了该ADC中的采样保持电路和每一级子ADC中的动态比较器的结构设计，以提升整个ADC的性能、降低整个ADC的芯片面积和功耗。采用0．18μmCMOS工艺完成加工后，测得该ADC在输入信号为36．25MHz，采样速率为80MHz下的信噪比（SNR）为49．6dB，有效位数（ENOB）为7．98位，典型的功耗电流只有18mA，整个ADC的芯片面积为0．5mm^2。

A low-power Analog-to-Digital Converter （ADC） with 8-bit 80MS/s is designed using a 7-stage pipeline structure with 1.5bit precision in each stage, i.e., 7-stage sub ADC. In order to improve the peffomlanee of the whole ADC and reduce the chip area and power consumption of the whole ADC, the sample-and-hold circuit of the ADC and the structure design of the dynamic eomparator in each stage of the ADC are mainly considered. The ADC is fabricated by 0.18 μm CMOS process, and the signal-to-noise ratio （SNR） of the ADC is 36.25 MHz; when the sampling rate is 80MHz, the signal-to-noise ratio （SNR） is 49.6 dB, the effective number of bits （ENOB） is 7.98 bits, the typical power consumption current is only 18 mA...

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