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组合逻辑电路的软错误率分析与加固
资料介绍
介绍了一种面向标准单元设计流程的软错误率（SER）分析及电路加固方法,其适用于组合电路以及时序逻辑的组合部分。采用该方法对ISCAS’85 Benchmark电路进行实验分析的结果表明,其运行速度快,在引入较小面积、时序开销的前提下取得了很好的加固效果。
A Soft Error Rate Analysis and hardening method intended for standard unit design flow,suitable for the combination parts of combination circuits and sequential logic result of the experimental analysis of ISCAS＇85 Benchmark circuit using this method shows that the operation is fast and better reinforcement result can be obtained under the premise of small area and sequential overhead.
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