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抗谐波锁定的延时锁相环
资料介绍
为了解决传统延时锁相环(DLL)结构在宽频率锁定范围中的无法锁定和谐波锁定问题,在传统DLL结构中加入启动控制电路,使DLL在上电阶段把环路滤波电容上的电压充电至电源电压,从而使压控延时线的初始延时在上电后达到最小,并且小于输入参考信号的1个周期.设计了带开关控制的鉴相器,将DLL的锁定过程分为粗调和微调两个阶段,压控延时线的延时在粗调阶段只能逐渐增大,在微调阶段微调,直到延时为输入参考信号的1个周期,从而克服了无法锁定以及谐波锁定的问题,而且减小了DLL的锁定时间.采用GSMC 0.13μm 1P7M CMOS 工艺设计、1.2V的电源电压进行仿真,结果表明该DLL工作频率范围为300～500MHz,功耗小于3mW.
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| 抗谐波锁定的延时锁相环.pdf | 323K |
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