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FPGA读写OV5640摄像头显示例程 Verilog逻辑源码Quartus工程文件+文档说明 FP
资料介绍
FPGA读写OV5640摄像头显示例程 Verilog逻辑源码Quartus工程文件+文档说明,FPGA型号Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。
本实验将采用 500 万像素的 OV5640 摄像头模组(模块型号:AN5640)为大家显示更高分辨率
的视频画面。OV5640 摄像头模组最大支持 QSXGA (2592x1944)的拍照功能,支持 1080P、720P、
VGA、QVGA 视频图像输出。本实验将 OV5640 配置为 RGB565 输出,先将视频数据写入外部存储
器,再从外部存储器读取送到 VGA、LCD 等显示模块。
module top(
input clk,
input rst_n,
output cmos_scl, //cmos i2c clock
inout cmos_sda, //cmos i2c data
input cmos_vsync, //cmos vsync
input cmos_href, //cmos hsync refrence,data valid
input cmos_pclk, //cmos pxiel clock
output cmos_xclk, //cmos externl clock
input [7:0] cmos_db, //cmos data
output cmos_rst_n, //cmos reset
output cmos_pwdn, //cmos power down
output vga_out_hs, //vga horizontal synchronization
output vga_out_vs, //vga vertical synchronization
output[4:0] vga_out_r, //vga red
output[5:0] vga_out_g, //vga green
output[4:0] vga_out_b, //vga blue
output sdram_clk, //sdram clock
output sdram_cke, //sdram clock enable
output sdram_cs_n, //sdram chip select
output sdram_we_n, //sdram write enable
output sdram_cas_n, //sdram column address strobe
output sdram_ras_n, //sdram row address strobe
output[1:0] sdram_dqm, //sdram data enable
output[1:0] sdram_ba, //sdram bank address
output[12:0] sdram_addr, //sdram address
inout[15:0] sdram_dq //sdram data
);
parameter
部分文件列表
文件名 | 大小 |
21.OV5640摄像头显示例程.pdf | |
21_1_sdram_ov5640_vga/ | |
21_1_sdram_ov5640_vga/ax301_ax4010_base.tcl | 1KB |
21_1_sdram_ov5640_vga/db/ | |
21_1_sdram_ov5640_vga/db/.cmp.kpt | |
21_1_sdram_ov5640_vga/db/.ipregen.qmsg | 2KB |
21_1_sdram_ov5640_vga/db/a_gray2bin_6ib.tdf | 2KB |
21_1_sdram_ov5640_vga/db/a_graycounter_1lc.tdf | 4KB |
21_1_sdram_ov5640_vga/db/a_graycounter_577.tdf | 4KB |
21_1_sdram_ov5640_vga/db/alt_synch_pipe_8pl.tdf | 3KB |
21_1_sdram_ov5640_vga/db/alt_synch_pipe_9pl.tdf | 3KB |
... |
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