积分商城

最新搜索： 声呐 逆变恒流 零死角玩转STM32 HAL库 mpc5604c canopen esp32
您现在的位置是：首页 > 技术资料 > 一种基于FPGA快速进位链的时间数字转换电路
推荐星级：
  • 1
  • 2
  • 3
  • 4
  • 5

一种基于FPGA快速进位链的时间数字转换电路

更新时间：2020-10-21 13:37:04 大小：1M 上传用户：gsy幸运查看TA发布的资源 标签：fpga 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

设计了一种基于FPGA快速进位链的时间-数字转换电路.该电路采用延迟内插技术,引入双链结构消除建立/保持时间对寄存器阵列输出结果的影响,并采用半周期平均延迟测试法,在Xilinx Virtex-4芯片上实测获得了59.19ps的分辨率.该电路采用使能控制模块将寄存器阵列输出结果的锁定时间控制在一个时钟周期内.使用FPGA Editor软件对该电路中单级延迟宏单元进行配置,并利用用户约束文件替代传统的手工布局布线,使得电路具有可移植性.此外,利用该电路对实测芯片中的CLB组合开关参数进行了测试,结果满足数据手册中提供的参数值的范围.

A Time-to-Digital Converter（TDC）is implemented in a Field Programmable Gate Array（FPGA）using carry proposed architecture,based on the interpolation method,has double delay lines to eliminate the impact of setup time on the register achieves 59.19 ps resolution with a self-test method presented by this dead time is limited within one period by an enable control s TDC is easy to implement in hardware with configured a macro delay cell and user constraints instead of manual place and eover,the combinational delays of CLB switching characteristics are tested using this TDC.

部分文件列表

文件名 大小
一种基于FPGA快速进位链的时间数字转换电路.pdf 1M

【关注B站账户领20积分】

相关下载

全部评论(0)

暂无评论
评论赚积分>>

上传资源 上传优质资源有赏金

热门标签

更多>>

最新上传

  • 打赏
  • 30日榜单

热门下载

资料专题

推荐下载

本站上的所有资源均为源于网上收集或者由用户自行上传，仅供学习和研究使用，无任何商业目的，版权归原作如有侵权，请 来信指出，本站将立即改正。

ICP许可证号：京ICP证070360号     21IC电子网 2000- 版权所有

京ICP备11013301号

京公网安备 11010802024343号