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基于FPGA同步电路的实现
资料介绍
同步是通信系统中一个重要的问题。在数字通信中,除了要获取相干载波的载波同步外,位同步的提取是更为重要的一个环节。介绍了一种基于FPGA同步电路的实现而提出一种数字锁相环的位同步提取电路的方案,并已成功地用FPGA器件实现了此方案。此时钟提取电路可以快速、准确地对串行输入信码进行位同步时钟的提取,即使输入码流中有毛刺现象,该设计也有很好的时钟调整恢复功能,能极大地减小误码率。
Synchronization is one of the major parts in ides carrier synchronization,the extracting of bit synchronization is more important in digital this paper,an extracting circuit of bit synchronization based on digital phase-locked loop（PLL） is described,and it has been implemented successfully using FPGA circuitcan extract the bit synchronous clock in serial digital signals rapidly and accurately,and also reduce the burr and bit error rate（BER）.
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