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基于地址总线接口的四倍频编码器信号接口的FPGA实现
资料介绍
基于地址总线接口的四倍频编码器信号接口的FPGA实现
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| qep_data_bus | 1KB | 2005-12-15 21:56:06 |
| qep_data_bus/qep_data_bus.qpf | 1KB | 2005-11-16 09:42:36 |
| qep_data_bus/qep_data_bus.qsf | 6KB | 2005-12-19 18:40:38 |
| qep_data_bus/qep_data_bus.qws | 5KB | 2005-12-19 18:40:38 |
| qep_data_bus/cmp_state.ini | 1KB | 2005-12-19 18:40:40 |
| qep_data_bus/leospec.his | 1KB | 2005-12-11 21:29:40 |
| qep_data_bus/qep_data_bus.vwf | 58KB | 2005-12-15 20:47:58 |
| qep_data_bus/qep_data_bus.fld | 1KB | 2005-12-19 15:39:12 |
| qep_data_bus/qep_data_bus.ppl | 1KB | 2005-12-19 15:47:08 |
| qep_data_bus/qep_data_bus.cdf | 1KB | 2005-12-15 21:37:06 |
| qep_data_bus/leospec.log | 21KB | 2005-12-11 21:29:40 |
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