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FPGA实现串口的收发，可以改波特率。Verilog HDL语言
资料介绍
FPGA实现串口的收发，可以改波特率。Verilog HDL语言
部分文件列表
| 文件名 | 大小 |
| UART/ | |
| UART/ALT_PPL1.ppf | |
| UART/ALT_PPL1.qip | |
| UART/ALT_PPL1.v | |
| UART/ALT_PPL1_bb.v | |
| UART/Block1.bdf | |
| UART/UART.asm.rpt | 7KB |
| UART/UART.bsf | 3KB |
| UART/UART.cdf | |
| UART/UART.done | |
| UART/UART.fit.rpt | |
| ... | |
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