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基于FPGA的UART设计，包含接收模块，发送模块，FIFO模块
资料介绍
基于FPGA的UART设计，包含接收模块，发送模块，FIFO模块
部分文件列表
| 文件名 | 大小 |
| UART/ | |
| UART/db/ | |
| UART/db/altsyncram_7kd1.tdf | |
| UART/db/a_dpfifo_0r21.tdf | 6KB |
| UART/db/cmpr_un8.tdf | 2KB |
| UART/db/cntr_95b.tdf | 3KB |
| UART/db/cntr_a5b.tdf | 3KB |
| UART/db/cntr_m57.tdf | 3KB |
| UART/db/prev_cmp_UART.asm.qmsg | 2KB |
| UART/db/prev_cmp_UART.eda.qmsg | 2KB |
| UART/db/prev_cmp_UART.fit.qmsg | |
| ... | |
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