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FPGA的抢答器设计.
资料介绍
本次设计的抢答器能够同时供应4位选手或者4个代表队进行抢答比
赛，分别使用4个按钮a,b，c，d表示。同时需要设置系统复位和抢答控制开关，
这需由主持人控制。主持人在允许抢答的情况下，计时器开始从30s开始倒
计时，直到有人抢答成功后，由锁存器将时间锁存住，此时数码管上将显示
剩余时间及抢答成功选手号码，同时对应选手的LED灯也被点亮。在判断
选手是否回答正确后，由主持人控制加减按钮进行给分。在一轮比赛结束后，
主持人按下复位按钮，则除了计分模块外，其他模块都复位为初始时刻，为
下一轮的比赛做好准备。
系统芯片主要采用EP2C8Q208，由抢答判别模块，计时模块，分频器
模块，计分模块，锁存器模块，数码管驱动模块组成。经过编译及其仿真所
设计的程序，该设计的抢答器基本能够实现此次设计的要求，从而完成了抢
答器应具备的功能。
部分文件列表
| 文件名 | 大小 |
| 基于FPGA的抢答器设计.pdf | 6M |
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