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FPGA的数字时钟的设计
资料介绍
该文档为基于FPGA的数字时钟的设计讲解文档，
在QuartusⅡ开发环境下，用Verilog HDL硬件描述语言设计了一个可以在FPGA芯片上实现的数字 时钟．通过将设计代码下载到FPGA的开发平台Ahera DE2开发板上进行了功能验证．由于数字时钟的通用性 及Verilog HDL语言的可移植性，冈此本数字时钟可直接应用于各种不同系列的FPGA芯片的设计中．
关键词：数字时钟；Verilog HDL；FPGA；QuartusⅡ
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| 文件名 | 大小 |
| 基于FPGA的数字时钟的设计.pdf | 209K |
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全部评论(1)
2018-09-06 15:10:55fhl1004
基于FPGA的数字时钟的设计讲解文档，在QuartusⅡ开发环境下，用Verilog HDL硬件描述语言设计了一个可以在FPGA芯片上实现的数字时钟，细致实用