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FIR数字滤波器程序，采用VHDL编写，可用于FPGA电路
资料介绍
FIR数字滤波器程序，采用VHDL编写，可用于FPGA电路
部分文件列表
| 文件名 | 大小 |
| 16AdderBalanced.vhd | 7KB |
| 16ADDERBALANCED_old.vhd | 7KB |
| 1BITADDER.VHD | 3KB |
| 1bitpfa.vhd | 2KB |
| 4bitcla.vhd | 9KB |
| 8bitreg3.vhd | 3KB |
| ADDERDELAY.VHD | 2KB |
| BalancedMult.VHD | |
| CoefficientTest.vhd | 6KB |
| comb0.vhd | 4KB |
| comb1.vhd | 3KB |
| ... | |
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