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FPGA / CPLD规范
资料介绍
Epi CPLD的主要任务是为EPI上的各种设施提供编程输出，并且只要“receive_in”引脚发生状态变化（如按钮按下），就能够在Ozy上向主处理器发送消息。
I2C总线用作编程路径和消息路径。器件上有两个I2C端口，主要用于简化内部三态控制。这些应连接在EPI板上的单个I2C总线上。 Epimetheus的Verilog代码实现了I2C从器件，可将I2C活动转换为Wishbone总线周期。这些Wishbone事务可以针对三个从属中的一个，I2C Master（来自OpenCores），“Epi_ctl_regs”模块和“Status_mcode”模块。 “Status_ctl”模块用作另一个Wishbone主机，每当信号在“receive_in”线上改变状态时，它就会通过I2C主机发出消息。 “Wb_arb_mux”模块用作两个Wishbone总线主控器之间的仲裁器，并将数据总线馈送到三个I2C从器件中的每一个。
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| 文件名 | 大小 |
| Epi_cpld_v0.1.pdf | 353K |
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