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基于CPLD的多功能等精度数字频率计的设计
资料介绍
该文主要论述了利用CPLD进行测频计数,单片机实施控制实现多功能频率计的设计过程.该频率计利用等精度的设计方法,克服了基于传统测频原理的频率计的测量精度随被测信号频率的下降而降低的缺点.等精度的测量方法不但具有较高的测量精度,而且在整个频率区域保持恒定的测试精度.该频率计利用CPLD来实现频率、周期、脉宽和占空比的测量计数.利用单片机完成整个测量电路的测试控制、数据处理和显示输出.该文详细论述了硬件电路的组成和单片机的软件控制流程.其中硬件电路包括键控制模块、显示模块、输入信号整形模块以及单片机和CPLD主控模块.设计器件采用Atmel公司的单片机AT89C51和Altera公司的EPM7128SLC84-15.键控制模块设置5个功能键和3个时间选择键,键值的读入采用一片74LS165来完成;显示模块用8只74LS164完成LED的串行显示;被测信号经限幅后由两级直接耦合放大器进行放大,再经施密特触发器整形后输入CPLD;标准频率采用50MHz;单片机软件用汇编语言编写,软件模块对应于硬件电路的每一个部分,还包括部分数据计算和转换模块.
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| 基于CPLD的多功能等精度数字频率计的设计.pdf | 571K |
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