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Altera FPGA上的RAM源码，单端口结构
资料介绍
Altera FPGA上的RAM源码，单端口结构
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| RAM/db/altsyncram_56a1.tdf | 25KB | 2013-01-22 15:59:30 |
| RAM/db/mux_3nc.tdf | 2KB | 2013-01-22 16:00:08 |
| RAM/db/mux_umc.tdf | 2KB | 2013-01-22 16:17:54 |
| RAM/db/prev_cmp_ram.asm.qmsg | 2KB | 2013-01-22 16:50:06 |
| RAM/db/prev_cmp_ram.fit.qmsg | 82KB | 2013-01-22 16:50:06 |
| RAM/db/prev_cmp_ram.map.qmsg | 4KB | 2013-01-22 16:51:10 |
| RAM/db/prev_cmp_ram.qmsg | 25KB | 2013-01-22 16:51:56 |
| RAM/db/prev_cmp_ram.sim.qmsg | 4KB | 2013-01-22 16:51:56 |
| RAM/db/prev_cmp_ram.tan.qmsg | 36KB | 2013-01-22 16:50:06 |
| RAM/db/ram.(0).cnf.cdb | 8KB | 2013-01-22 16:51:16 |
| RAM/db/ram.(0).cnf.hdb | 2KB | 2013-01-22 16:51:16 |
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