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基于Altera FPGA的DPRAM IPcore设计,包含整个工程和modelsim仿真文件
资料介绍
基于Altera FPGA的DPRAM IPcore设计,包含整个工程和modelsim仿真文件。读写地址及读写使能是通过数据产生模块来产生
部分文件列表
文件名 | 文件大小 | 修改时间 |
dpramcore/datagenerate.v.bak | 1KB | 2012-02-28 14:56:56 |
dpramcore/db/altsyncram_13s1.tdf | 14KB | 2012-03-01 08:30:32 |
dpramcore/db/altsyncram_3gi1.tdf | 12KB | 2012-03-01 08:58:40 |
dpramcore/db/altsyncram_lqr1.tdf | 13KB | 2012-02-28 22:35:38 |
dpramcore/db/dpram_core.(0).cnf.cdb | 2KB | 2012-03-01 08:30:32 |
dpramcore/db/dpram_core.(0).cnf.hdb | 1KB | 2012-03-01 08:30:32 |
dpramcore/db/dpram_core.(1).cnf.cdb | 2KB | 2012-03-01 08:30:32 |
dpramcore/db/dpram_core.(1).cnf.hdb | 1KB | 2012-03-01 08:30:32 |
dpramcore/db/dpram_core.(2).cnf.cdb | 1KB | 2012-03-01 08:30:32 |
dpramcore/db/dpram_core.(2).cnf.hdb | 1KB | 2012-03-01 08:30:32 |
dpramcore/db/dpram_core.(3).cnf.cdb | 2KB | 2012-03-01 08:30:32 |
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