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基于AES算法的数据加密与解密硬件设计
资料介绍
21世纪是信息快速发展的时代，随着计算机网络的应用越来越广泛，网络安全也逐渐成为人们普遍关注的课题。可以预言，今后的社会将进入全面的网络时代和信息共享时代，因此，网络安全极其重要，只有安全的网络才能保证网络生活能够有序进行、网络系统不遭破坏、信息不被窃取、网络服务不被非法中断等。为了保证计算机网络的可靠性、可用性、完整性、保密性和真实性等安全性，不仅要保证计算机网络设备安全和计算机网络系统安全，还要保护数据的安全。
对数据实施安全的加密算法是保护数据安全的有效手段。
AES（advanced encryption standard）是美国国家标准和技术研究所宣布采用的高级加密标准，可以预测，AES在今后很长的一段时间内将会在信息安全中扮演重要的角色，因此对AES算法实现的研究成为国内外的热点，它将会在信息安全领域得到广泛的应用。AES在实现方面具有速度快、可并行处理、对处理器的结构无特殊要求，算法设计相对简单，分组长度可以改变，而且具有很好的可扩充性。AES算法的这些特点使得选用FPGA来实现AES算法具有很好的优越性，本文就是针对AES算法的FPGA实现进行研究。
本文介绍了用FPGA实现AES算法所用的开发工具、开发语言和所选用的芯片，还具体介绍了AES算法的硬件实现方式，在此基础上，着重阐述了AES算法FPGA实现的总体设计框图，并对各个部分的设计分别给与介绍，给出了实现加密解密的时序仿真和设计结果。
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资料：bitboy
全部评论(2)
2021-03-31 15:22:48zzwwzz
不错
2020-04-22 10:45:34love11
谢谢