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基于半动态电路的32位高性能加法器设计

更新时间：2020-05-17 10:37:32 大小：314K 上传用户：xiaohei1810查看TA发布的资源 标签：加法器 下载积分：5分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

描述了一种采用半动态电路的32位高性能加法器的设计.设计中改进了现有稀疏树结构中的输出进位逻辑,在此基础上,设计了一种容偏斜多米诺和静态电路相结合的半动态电路,以及相应的多个控制时钟的时序策略.根据几种不同的加法器负载驱动情况,分别设计出不同的电路尺寸.采用SMIC 1.8V0.18μm CMOS工艺,在不同条件下的仿真结果表明,加法器电路取得了良好的性能.

This paper presents a programme of designing 32 bit high-performance adder with semi-dynamic h modified output carry logic in sparse-tree structure,the semi-dynamic adder circuit,which includes skew-tolerant dynamic domino-circuit and static circuit,and its multiple clocks timing scheme were different transistor＇s sizes of adder were designed to fit the different loads and drive conditions of the SMIC 1.8 V 0.18 μm technology,the simulation results under different conditions show that the designed adder has a high performance.

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