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  • Xilinx ISE9.x FPGA_CPLD设计指南(原书光盘上的源码)

    大小:9M 更新时间:2021-01-28 下载积分:2分

    Xilinx ISE9.x FPGA_CPLD设计指南(原书光盘上的源码),共29个工程例子。大部分工程分VHDL和Verilog两个,可供参考。

    标签:xilinxfpgacpld
  • Active-HDL 9.1crack

    大小:4M 更新时间:2014-08-06 下载积分:1分

    1.将Dat目录中license.dat中的HOSTID=换成自己的网卡地址; 2.将BIN Dat中的文件分别复制到安装目录下对应目录BIN、Dat文件夹里覆盖原文件

    标签:EDA相关
  • spi接收模块

    大小:1K 更新时间:2014-02-19 下载积分:2分

    VHDL下SPI接口的数据接收模块,模块要接收的数据位数,对不同接收位数的地方使用本模块时,只需改本参数即可

    标签:接收模块
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lwprayto

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