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  • VHDL8b10b编码

    大小：9K 更新时间：2017-10-29 下载积分：2分

    采用VHDL语言编写了8b10b编解码源代码，然后在modelsim中进行RTL级代码仿真得到仿真图

    标签：vhdl8b10b编码逻辑关系

  • Veriog8b10b编码

    大小：2K 更新时间：2017-10-29 下载积分：2分

    采用verilog语言基于查找表编写了8b10b编码代码，用modelsim进行了RTL级代码仿真，可以得到正确的仿真图

    标签：8b10b编码verilog查找表实现

  • 并串/串并转换模块

    大小：2K 更新时间：2017-10-29 下载积分：2分

    采用verilog语言编写并串转换模块，有8位并串转换和16位并串转换代码。其中8位并串转换有a和b两种方法实现且b方法代码为并串转换和串并转换合在一起的代码。

    标签：Verilog并串串并转换
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