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XilinxFPGA内部结构深入分析
资料介绍
IOB 的结构
请大家看到手册的第1 页，这是IOB 的review 部分。
IO block 是高手的领地，一般接触FPGA 第一年都不会太关心到这个部分。
注意看， IOB 有三个数据通道：输入、输出、三态控制。
每个通道都有一对存储器件，他们可以当做寄存器或者锁存起来使用，视乎你的设置。
输入通道有可编程的延迟模块， 可以确保hold time 为零。（这是在什么场合使用？请达人补
充！）
另外可以看到输入输出通道都有完备的DDR 支持，这个在后面可以看到。
所有图都请参考PDF 原文，这里就不再粘贴了。
可编程输入延迟
看到手册第3 页，这个像两根鱼骨似的构造就是输入延迟了。
输入延迟一共16 节，每节250ps，所以总共的延迟在0~4ns 之间。
这个鱼骨的构造非常巧妙，前面8 节直接级联，只有一个输出。
这样8 节以内的调整就跳过这根长鱼骨； 而超过8 节的调整就直接利用第一根鱼骨， 然后在
后面的8 节中进行微调。
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资料：bitboy
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