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Xilinx FPGA Vivado 2014 示例 hls_basic

更新时间：2022-12-04 17:32:56 大小：4M 上传用户：Laspide查看TA发布的资源 标签：xilinxfpgavivado 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

Xilinx FPGA权威设计指南——Vivado 2014集成开发环境 配套的工程示例。 基于Xilinx集成开发环境Vivado 2014.3的设计方法、设计流程和具体实现，内容包括：Xilinx UltraScale结构、Vivado集成设计环境导论、Vivado工程模式基本设计实现、Vivado非工程模式基本设计实现、创建和封装用户IP核流程、Vivado高级约束原理及实现、Vivado调试工具原理及实现、Vivado嵌入式系统设计实现、Vivado模型设计原理及实现、Vivado HLS原理及实现、Vivado部分可重配置原理及实现。参考了Xilinx提供的大量Vivado最新设计资料，理论与应用并重，将Xilinx最新的设计理论贯穿在具体的设计实现中。 这是hls_basic的示例。

部分文件列表

文件名文件大小修改时间
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/111KB2013-12-16 14:29:06
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/gate.c1KB2014-11-04 20:43:26
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/gate.h1KB2013-12-16 12:19:28
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/gate.prj/.apc/autopilot.apfmapping1KB2014-11-04 20:41:24
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/gate.prj/.cproject22KB2014-11-04 21:46:26
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/gate.prj/.project4KB2014-11-04 20:41:24
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/gate.prj/.settings/gate.prj.Debug.launch2KB2014-11-04 20:41:26
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/gate.prj/.settings/gate.prj.Release.launch2KB2014-11-04 20:41:26
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/gate.prj/.vivado_hls_log_all.xml1KB2014-11-04 20:41:36
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/gate.prj/solution1/.autopilot/.automg_exit1KB2014-11-04 20:42:06
Xilinx FPGA Vivado 2014 示例 hls_basic/logic_gate/gate.prj/solution1/.autopilot/.autopilot_exit1KB2014-11-04 20:42:08
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