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一个基于Xilinx FPGA的DDRS DRAM的Verilog控制代码

更新时间：2019-10-17 21:45:08 大小：464K 上传用户：lalahug查看TA发布的资源 标签：xilinxfpgaddrsdramverilog 下载积分：9分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

一个基于Xilinx FPGA的DDRS DRAM的Verilog控制代码，使用的FPGA为Virtex完整源代码

image.png

部分文件列表

文件名文件大小修改时间
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top.txt3KB2007-09-27 14:55:06
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top_addr_gen_0.txt5KB2007-09-27 14:55:06
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top_backend_fifos_0.txt4KB2007-09-27 14:55:06
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top_backend_rom_0.txt6KB2007-09-27 14:55:06
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top_cmp_rd_data_0.txt6KB2007-09-27 14:55:06
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top_controller_iobs_0.txt4KB2007-09-27 14:55:06
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top_data_gen_16.txt7KB2007-09-27 14:55:06
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top_data_path_0.txt4KB2007-09-27 14:55:06
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top_data_path_iobs_0.txt56KB2007-09-27 14:55:06
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top_data_tap_inc.txt4KB2007-09-27 14:55:06
FPGASDRAMverilog/FPGASDRAMverilog/mem_interface_top_data_write_0.txt5KB2007-09-27 14:55:06
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