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精通VerilogHDL语言编程_光盘文件

更新时间:2023-09-30 17:37:52 大小:47K 上传用户:gsy幸运查看TA发布的资源 标签:verilog hdl 下载积分:4分 评价赚积分 (如何评价?) 打赏 收藏 评论(0) 举报

资料介绍

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部分文件列表

文件名文件大小修改时间
DVB-C信道编、解码器.sch61KB2006-12-14 17:21:34
光盘文件说明.doc27KB2007-03-27 10:53:58
实例程序代码/第15章 常用加法器设计/carry_chain_adder.v1KB2006-12-05 10:37:30
实例程序代码/第15章 常用加法器设计/carry_skip_adder.v1KB2006-12-05 10:38:36
实例程序代码/第15章 常用加法器设计/ripple_carry_adder.v1KB2006-12-05 10:36:50
实例程序代码/第16章 常用乘法器设计/basic_base2_mul.v1KB2006-12-05 10:47:46
实例程序代码/第16章 常用乘法器设计/basic_base2_mul_seq.v1KB2006-12-05 10:48:20
实例程序代码/第16章 常用乘法器设计/carry_save_mult.v1KB2006-12-05 10:50:12
实例程序代码/第16章 常用乘法器设计/ripple_carry_mult.v1KB2006-12-05 10:49:02
实例程序代码/第17章 伽罗华域GF(q)乘法器设计/ff_const_mul.v1KB2006-12-05 11:38:50
实例程序代码/第17章 伽罗华域GF(q)乘法器设计/ff_mul.v2KB2006-12-05 11:36:54
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