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基于脉动结构的有限域乘法器Verilog设计源代码
资料介绍
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/cell1.v | 1KB | 2010-01-04 11:42:24 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/cell2.v | 1KB | 2010-01-04 11:42:24 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/DFF1.v | 1KB | 2010-01-04 11:42:24 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/DFF16.V | 1KB | 2010-01-04 11:42:24 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/DFF32.v | 1KB | 2010-01-04 11:42:24 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/DFF8.V | 1KB | 2010-01-04 11:42:24 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/MUX.v | 1KB | 2010-01-04 11:42:24 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/PE16.V | 67KB | 2010-01-04 11:42:24 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/PE32.V | 235KB | 2010-01-04 11:42:24 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/PE8.V | 22KB | 2010-01-04 11:42:24 |
| 基于脉动结构的有限域乘法器Verilog设计源代码/tb_TOP32.v | 2KB | 2010-01-04 11:42:24 |
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