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SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文
资料介绍
SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/chipscope_icon.ngc | 31KB | 2015-11-04 11:28:14 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/chipscope_icon.v | 1KB | 2015-11-04 11:28:14 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/chipscope_ila.ngc | 898KB | 2015-11-04 11:28:14 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/chipscope_ila.v | 1KB | 2015-11-04 11:28:12 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/ipcore_dir/coregen.cgp | 1KB | 2015-11-04 11:32:00 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/ipcore_dir/coregen.log | 3KB | 2015-11-04 11:32:00 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/ipcore_dir/create_rom_ip.tcl | 1KB | 2015-11-04 11:32:00 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/ipcore_dir/rom_ip/blk_mem_gen_v7_3_readme.txt | 8KB | 2015-11-04 11:33:26 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/ipcore_dir/rom_ip/doc/blk_mem_gen_v7_3_vinfo.html | 8KB | 2015-11-04 11:35:42 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/ipcore_dir/rom_ip/doc/pg058-blk-mem-gen.pdf | 7039KB | 2015-11-04 11:35:42 |
| SPARTAN6 FPGArom读写_test实验 VERILOG逻辑例程源码 ISE14.7工程文件/ipcore_dir/rom_ip/example_design/rom_ip_exdes.ucf | 3KB | 2015-11-04 11:35:42 |
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