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Modelsim工程，用Verilog实现的HDB3编码，以及测试程序Testbench

更新时间：2019-10-19 17:47:50 大小：22K 上传用户：lalahug查看TA发布的资源 标签：modelsimverilog 下载积分：5分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

Modelsim工程，用Verilog实现的HDB3编码，以及测试程序Testbench

image.png

部分文件列表

文件名文件大小修改时间
hdb3/decode.v2KB2007-01-18 09:50:56
hdb3/testbench.v1KB2007-01-17 20:25:32
hdb3/testbench.v.bak1KB2007-01-17 19:51:24
hdb3/work/_info1KB2007-01-18 09:51:40
hdb3/work/testbench/_primary.vhd1KB2007-01-18 09:43:38
hdb3/work/testbench/verilog.asm7KB2007-01-18 09:43:38
hdb3/work/testbench/_primary.dat1KB2007-01-18 09:43:38
hdb3/work/testbench1KB2007-01-18 09:42:02
hdb3/work/decode/_primary.vhd1KB2007-01-18 09:51:40
hdb3/work/decode/verilog.asm11KB2007-01-18 09:51:40
hdb3/work/decode/_primary.dat2KB2007-01-18 09:51:40
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