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基于虚拟仪器的时序逻辑电路仿真实验平台设计
资料介绍
基于虚拟仪器技术的时序逻辑,电路仿真实验平台对时序逻辑电路的基本实验进行了功能设计,同时进行了仿真过程演示。通过该平台的仿真演示,学生可直观地观察到时序逻辑电路的功能和运行状态的变化,该平台具有操作简单的优点。该平台的设计方法,是将学生引入'设计型实验'的一种有效途径。
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| 基于虚拟仪器的时序逻辑电路仿真实验平台设计.pdf | 1M |
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