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FPGA设计FIFO IP核读写实验 带ModelSIm和SignalTap II调试Quartus
资料介绍
部分文件列表
| 文件名 | 大小 |
| Verilog_Ip_FIFO/ | |
| Verilog_Ip_FIFO/FIFO.qip | |
| Verilog_Ip_FIFO/FIFO.v | 6KB |
| Verilog_Ip_FIFO/FIFO_bb.v | 5KB |
| Verilog_Ip_FIFO/FIFO_inst.v | |
| Verilog_Ip_FIFO/Verilog_Ip_FIFO.pti_db_list.ddb | |
| Verilog_Ip_FIFO/Verilog_Ip_FIFO.qpf | 1KB |
| Verilog_Ip_FIFO/Verilog_Ip_FIFO.qsf | |
| Verilog_Ip_FIFO/Verilog_Ip_FIFO.qws | |
| Verilog_Ip_FIFO/Verilog_Ip_FIFO.tis_db_list.ddb | |
| Verilog_Ip_FIFO/Verilog_Ip_FIFO.v | 1KB |
| ... | |
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