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FPGA程序，verilog HDL语言编写的秒表程序，使用quartus II 13.0 开发

更新时间：2019-10-17 22:18:14 大小：3M 上传用户：lalahug查看TA发布的资源 标签：fpgaverilog hdl 下载积分：9分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

FPGA程序，verilog HDL语言编写的秒表程序，使用quartus II 13.0 开发

部分文件列表

文件名文件大小修改时间
stopwatch/ClkDivToPuls.v1KB2013-12-02 14:25:46
stopwatch/db/logic_util_heursitic.dat15KB2013-12-11 16:01:04
stopwatch/db/prev_cmp_stopwatch.qmsg44KB2013-12-11 16:00:54
stopwatch/db/stopwatch.(0).cnf.cdb6KB2013-12-11 16:00:56
stopwatch/db/stopwatch.(0).cnf.hdb2KB2013-12-11 16:00:56
stopwatch/db/stopwatch.(1).cnf.cdb3KB2013-12-04 14:57:24
stopwatch/db/stopwatch.(1).cnf.hdb1KB2013-12-04 14:57:24
stopwatch/db/stopwatch.(10).cnf.cdb3KB2013-12-11 16:00:56
stopwatch/db/stopwatch.(10).cnf.hdb1KB2013-12-11 16:00:56
stopwatch/db/stopwatch.(2).cnf.cdb10KB2013-12-10 15:55:08
stopwatch/db/stopwatch.(2).cnf.hdb2KB2013-12-10 15:55:08
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