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Cadence数模混合电路设计-spetreVerilog
资料介绍
路径设置
首先要设置路径，可以这样设置（icfb和
ius和在一起了）：
setenv ic50/tools/cadence/ic5141
setenv ius58/opt/cadence/ius58
set LD LIBRARY PATH=（$ic50/tools/lib $ic50/tools/dfI/1
ib $ic50/tools/tcltk/tcl8.0/lib Sic50/tools/tcltk/tk8.0/lib ${ius58
}/tools/verilog/lib Sius58/tools/lib SLD LIBRARY_PATH）
set path=（${ius58}/tools/verilog/bin Sius58/tools/bin Sic50/tools/bin S$ic50/tools/dflI/bin $ic50/tools/dracula/bin $path）
步骤：
1.在icfb中建立verilog的view，（包括模块和testbench，testbench的view名也是verilog
2.右键点击testbench的verilog view，选择“open（read-only）”在verilog阅读窗的菜单上选择tools=>verilog-xl
3.用verilog-xl仿真，试一试就会用了仿真完成后View Waveform的按钮会被激活按这个按钮，simvision打开
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| Cadence数模混合电路设计-spetreVerilog.pdf | 15M |
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