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Altera FPGA的UART通讯程序
资料介绍
Altera FPGA的UART通讯程序 Altera FPGA的UART通讯程序
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| uart_tb.v.bak | 1KB | 2007-11-29 14:58:48 |
| uart_tb.vcd | 3247KB | 2007-11-29 16:07:46 |
| vsim.wlf | 40KB | 2007-11-29 16:07:46 |
| rtl_wrk/@rx/verilog.asm | 13KB | 2007-11-29 15:11:30 |
| rtl_wrk/@rx/_primary.dat | 1KB | 2007-11-29 15:11:30 |
| rtl_wrk/@rx/_primary.vhd | 1KB | 2007-11-29 15:11:30 |
| rtl_wrk/@tx/verilog.asm | 9KB | 2007-11-29 15:11:30 |
| rtl_wrk/@tx/_primary.dat | 1KB | 2007-11-29 15:11:30 |
| rtl_wrk/@tx/_primary.vhd | 1KB | 2007-11-29 15:11:30 |
| rtl_wrk/uart_tb/verilog.asm | 8KB | 2007-11-29 15:11:30 |
| rtl_wrk/uart_tb/_primary.dat | 1KB | 2007-11-29 15:11:30 |
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