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Altera的DDR控制器源码（包括仿真与说明文档），DDR为mt46v4m16，Verilog

更新时间：2019-10-17 19:31:12 大小：736K 上传用户：zyf901126查看TA发布的资源 标签：alteraddr控制器 下载积分：9分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

Altera的DDR控制器源码（包括仿真与说明文档），DDR为mt46v4m16，Verilog

部分文件列表

文件名文件大小修改时间
altera_ddr_verilog/doc/ddr_sdram.pdf462KB2000-05-30 09:59:32
altera_ddr_verilog/model/mt46v4m16.v44KB2000-03-29 21:36:48
altera_ddr_verilog/readme.txt1KB2000-06-02 12:04:14
altera_ddr_verilog/route/ddr_sdram.csf10KB2000-06-02 15:03:00
altera_ddr_verilog/route/ddr_sdram.esf1KB2000-06-02 15:02:58
altera_ddr_verilog/route/ddr_sdram.psf2KB2000-06-02 15:03:00
altera_ddr_verilog/route/ddr_sdram.quartus1KB2000-06-02 15:03:00
altera_ddr_verilog/route/ddr_sdram.vqm581KB2000-05-22 13:06:26
altera_ddr_verilog/route/pll1.v5KB2000-05-20 12:02:40
altera_ddr_verilog/simulation/ddr_compile_all.v1KB2000-05-20 12:07:06
altera_ddr_verilog/simulation/ddr_sdram_tb.v18KB2000-05-19 17:58:12
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