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如何写好状态机_Verilog_CH06_FSM
资料介绍
节选自《Verilog 设计与验证》作者：吴继华、王诚
状态机是逻辑设计的重要内容，状态机的设计水平直接反应工程师的逻辑功底，所以许
多公司的硬件和逻辑工程师面试中，状态机设计几乎是必选题目。本章在引入状态机设计思
想的基础上，重点讨论如何写好状态机。
部分文件列表
| 文件名 | 大小 |
| 如何写好状态机_Verilog_CH06_FSM.pdf | 452K |
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